電離層數(shù)字測高儀中的脈沖壓縮技術及其FPGA實現(xiàn)

使用現(xiàn)代雷達信號處理系統(tǒng)中廣泛應用的數(shù)字脈沖壓縮技術,在FPGA硬件平臺上設計實現(xiàn)了電離層數(shù)字測高儀接收機模塊中用于對13位巴克碼進行解碼的相關運算電路,解決了電離層數(shù)字測高儀中目標作用距離與距離分辨率之間的矛盾.實驗結果表明:基于FPGA的相關運算電路處理速度快,精度高,實時性好,完全滿足電離層數(shù)字測高儀對解碼電路的性能指標和技術要求.

作 者： 朱正平 周健勇 陳琨 張澤奎 Zhu Zhengping Zhou Jianyong Chen Kun Zhang Zekuei   作者單位： 朱正平,Zhu Zhengping(中南民族大學,電子信息工程學院,武漢,430074)

周健勇,陳琨,張澤奎,Zhou Jianyong,Chen Kun,Zhang Zekuei(中南民族大學,等離子體物理研究所,武漢,430074) 

刊 名： 中南民族大學學報（自然科學版）  英文刊名： JOURNAL OF SOUTH-CENTRAL UNIVERSITY FOR NATIONALITIES(NATURAL SCIENCE EDITION)  年，卷(期)： 2009 25(2)  分類號： P353  關鍵詞： 電離層數(shù)字測高儀   脈沖壓縮   相關運算   FPGA平臺  

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